4.5.3　环路滤波器的Verilog HDL实现 （112）
4.5.4　载波同步环的FPGA实现 （114）
4.6　载波同步环的仿真测试 （115）
4.6.1　测试激励的Verilog HDL设计 （115）
4.6.2　单载波输入信号的仿真测试 （117）
4.6.3　调幅输入信号的仿真测试 （121）
4.6.4　关于载波同步环参数的讨论 （123）
4.7　载波同步环的板载测试 （125）
4.7.1　硬件接口电路 （125）
4.7.2　板载测试程序 （126）
4.7.3　板载测试验证 （129）
4.8　小结 （130）
第5章　抑制载波同步的FPGA实现 （131）
5.1　抑制载波同步的原理 （131）
5.1.1　平方环的工作原理 （131）
5.1.2　同相正交环的工作原理 （132）
5.1.3　判决反馈环的工作原理 （134）
5.2　输入信号建模与仿真 （135）
5.2.1　工程实例需求 （135）
5.2.2　DPSK信号的调制原理及特征 （135）
5.2.3　DPSK信号传输模型及仿真 （137）
5.3　平方环的FPGA实现 （139）
5.3.1　改进的平方环原理 （139）
5.3.2　改进的平方环性能参数设计 （139）
5.3.3　带通滤波器设计 （140）
5.3.4　顶层模块的Verilog HDL实现 （142）
5.3.5　带通滤波器的Verilog HDL实现 （145）
5.3.6　低通滤波器的Verilog HDL实现 （149）
5.3.7　FPGA实现后的仿真测试 （151）
5.4　同相正交环的FPGA实现 （153）
5.4.1　同相正交环性能参数设计 （153）
5.4.2　低通滤波器的Verilog HDL实现 （154）
5.4.3　其他模块的Verilog HDL实现 （155）
5.4.4　顶层模块的Verilog HDL实现 （156）
5.4.5　FPGA实现后的仿真测试 （159）
5.4.6　同相支路的判决及码型变换 （161）
5.5　判决反馈环的FPGA实现 （163）
5.5.1　判决反馈环的性能参数设计 （163）
5.5.2　顶层模块的Verilog HDL实现 （164）
5.5.3　积分判决模块的Verilog HDL实现 （167）
5.5.4　FPGA实现后的仿真测试 （169）
5.6　平方环的板载测试 （171）
5.6.1　硬件接口电路 （171）
5.6.2　板载测试程序 （171）
5.6.3　板载测试验证 （172）
5.7　小结 （173）
第6章　自动频率控制的FPGA实现 （174）
6.1　自动频率控制的概念 （174）
6.2　*大似然频差估计的FPGA实现 （175）
6.2.1　*大似然频差估计的原理 （175）
6.2.2　*大似然频差估计的MATLAB仿真 （177）
6.2.3　*大似然频差估计的FPGA实现方法 （179）
6.3　基于FFT载波频率估计的FPGA实现 （181）
6.3.1　离散傅里叶变换 （181）
6.3.2　FFT算法原理及MATLAB仿真 （183）
6.3.3　FFT核的使用 （186）
6.3.4　输入信号建模与MATLAB仿真 （188）
6.3.5　基于FFT频差估计的Verilog HDL实现 （189）
6.3.6　FPGA实现及仿真测试 （193）
6.4　FSK信号调制/解调原理 （194）
6.4.1　数字频率调制 （195）
6.4.2　FSK信号的MATLAB仿真 （196）
6.4.3　FSK信号的相干解调原理 （199）
6.4.4　AFC环解调FSK信号的原理 （200）
6.5　AFC环的FPGA实现 （202）
6.5.1　AFC环参数设计 （202）
6.5.2　顶层模块的Verilog HDL实现 （204）
6.5.3　鉴频器模块的Verilog HDL实现 （207）
6.5.4　FPGA实现及仿真测试 （208）
6.6　AFC环的板载测试 （209）
6.6.1　硬件接口电路 （209）
6.6.2　板载测试程序 （210）
6.6.3　板载测试验证 （212）
6.7　小结 （213）
第7章　数字锁相法位同步技术的FPGA实现 （214）
7.1　位同步的概念及实现方法 （214）
7.1.1　位同步的概念 （214）
7.1.2　利用滤波法提取位同步信号 （215）
7.1.3　利用数字锁相法提取位同步信号 （216）
7.2　微分型位同步环的FPGA实现 （218）
7.2.1　微分型位同步环的原理 （218）
7.2.2　顶层模块的Verilog HDL实现 （219）
7.2.3　双相时钟模块的Verilog HDL实现 （221）
7.2.4　微分鉴相模块的Verilog HDL实现 （223）
7.2.5　单稳态触发器模块的Verilog HDL实现 （225）
7.2.6　控制及分频模块的Verilog HDL实现 （226）
7.2.7　位同步信号形成及移相模块的Verilog HDL实现 （228）
7.2.8　FPGA实现及仿真测试 （230）
7.3　积分型位同步环的FPGA实现 （232）
7.3.1　积分型位同步环的原理 （232）
7.3.2　顶层模块的Verilog HDL实现 （234）
7.3.3　积分器模块的Verilog HDL实现 （236）
7.3.4　鉴相模块的Verilog HDL实现 （238）
7.3.5　FPGA实现及仿真测试 （239）
7.4　改进型位同步环的FPGA实现 （240）
7.4.1　正交支路积分输出门限判决法 （240）
7.4.2　数字滤波器法的工作原理 （242）
7.4.3　随机徘徊滤波器的Verilog HDL实现 （243）
7.4.4　随机徘徊滤波器的仿真测试 （244）
7.4.5　改进型数字滤波器的工作原理 （245）
7.4.6　改进型数字滤波器的Verilog HDL实现 （246）
7.5　微分型位同步环的板载测试 （249）
7.5.1　硬件接口电路 （249）
7.5.2　板载测试程序 （249）
7.5.3　板载测试验证 （250）
7.6　小结 （251）
第8章　插值算法位同步技术的FPGA实现 （252）
8.1　插值算法位同步技术的原理 （252）
8.1.1　插值算法的总体结构 （252）
8.1.2　内插滤波器的原理及结构 （252）
8.1.3　Gardner定时误差检测算法 （254）
8.1.4　环路滤波器与数控振荡器 （256）
8.2　插值算法位同步技术的MATLAB仿真 （257）
8.2.1　环路滤波器系数的设计 （257）
8.2.2　定时误差检测算法的MATLAB仿真程序 （258）
8.2.3　简化后插值算法位同步技术的仿真 （263）
8.3　插值算法位同步技术的FPGA实

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