数字通信同步技术的MATLAB与FPGA实现:Altera/Verilog版 本书特色

本书以Altera公司的FPGA为开发平台，以MATLAB及Verilog HDL为开发工具，详细阐述数字通信同步技术的FPGA实现原理、结构、方法和仿真测试过程，并通过大量的工程实例分析FPGA实现过程中的具体技术细节。本书主要内容包括FPGA实现数字信号处理基础、锁相环、载波同步、自动频率控制、位同步、帧同步等。本书思路清晰、语言流畅、分析透彻，在简明阐述设计原理的基础上，注重对工程实践的指导性，力求使读者在较短的时间内掌握数字通信同步技术的FPGA设计知识和技能。作者精心设计了与本书配套的FPGA开发板，详细介绍了工程实例的实验步骤及方法，形成了从理论到实践的完整学习过程，可以有效地加深读者对数字通信同步技术的理解。本书的配套资料收录了完整的MATLAB及Verilog HDL代码，有利于工程技术人员参考，读者可登录华信教育资源网（www.hxedu.com.cn）免费注册后下载。

数字通信同步技术的MATLAB与FPGA实现:Altera/Verilog版 目录

第1章　同步技术的概念及FPGA基础 （1）
1.1　数字通信中的同步技术 （1）
1.2　同步技术的实现方法 （3）
1.2.1　两种不同的实现原理 （3）
1.2.2　常用的工程实现途径 （4）
1.3　FPGA概念及其在信号处理中的应用 （5）
1.3.1　基本概念及发展历程 （5）
1.3.2　FPGA的结构和工作原理 （7）
1.3.3　FPGA在数字信号处理中的应用 （14）
1.4　Altera器件简介 （15）
1.5　Verilog HDL语言简介 （17）
1.5.1　HDL语言简介 （17）
1.5.2　Verilog HDL的特点 （18）
1.5.3　Verilog HDL的程序结构 （19）
1.6　FPGA开发工具及设计流程 （20）
1.6.1　Quartus II开发套件 （20）
1.6.2　ModelSim仿真软件 （23）
1.6.3　FPGA的设计流程 （25）
1.7　MATLAB软件 （28）
1.7.1　MATLAB简介 （28）
1.7.2　MATLAB工作界面 （28）
1.7.3　MATLAB的特点及优势 （29）
1.7.4　MATLAB与Quartus II的数据交互 （30）
1.8　FPGA开发板CRD500 （31）
1.8.1　CRD500简介 （31）
1.8.2　CRD500典型应用 （33）
1.9　小结 （33）
第2章　FPGA实现数字信号处理基础 （35）
2.1　FPGA中数的表示 （35）
2.1.1　莱布尼兹与二进制 （35）
2.1.2　定点数表示 （36）
2.1.3　浮点数表示 （37）
2.2　FPGA中数的运算 （40）
2.2.1　加/减法运算 （40）
2.2.2　乘法运算 （43）
2.2.3　除法运算 （45）
2.2.4　有效数据位的计算 （45）
2.3　有限字长效应 （48）
2.3.1　字长效应的产生因素 （48）
2.3.2　A/D转换器的字长效应 （49）
2.3.3　数字系统运算中的字长效应 （50）
2.4　FPGA中的常用运算处理模块 （52）
2.4.1　加法器模块 （52）
2.4.2　乘法器模块 （54）
2.4.3　除法器模块 （57）
2.4.4　浮点数运算模块 （58）
2.4.5　滤波器模块 （59）
2.5　小结 （61）
第3章　锁相环原理及应用 （63）
3.1　锁相环的原理 （63）
3.1.1　锁相环的模型 （63）
3.1.2　锁定与跟踪的概念 （64）
3.1.3　锁相环的基本性能要求 （65）
3.2　锁相环的组成 （66）
3.2.1　鉴相器 （66）
3.2.2　环路滤波器 （67）
3.2.3　压控振荡器 （68）
3.3　锁相环的动态方程 （68）
3.3.1　非线性相位模型 （68）
3.3.2　线性相位模型 （70）
3.3.3　锁相环的传递函数 （71）
3.4　锁相环的性能分析 （72）
3.4.1　暂态信号响应 （72）
3.4.2　锁相环的频率响应 （74）
3.4.3　锁相环的稳定性 （77）
3.4.4　非线性跟踪性能 （78）
3.4.5　锁相环的捕获性能 （80）
3.4.6　锁相环的噪声性能 （81）
3.5　锁相环的应用 （83）
3.5.1　锁相环的两种跟踪状态 （83）
3.5.2　调频解调器 （84）
3.5.3　调相解调器 （84）
3.5.4　调幅信号的相干解调 （85）
3.5.5　锁相调频器 （85）
3.5.6　锁相调相器 （86）
3.6　小结 （86）
第4章　载波同步的FPGA实现 （88）
4.1　载波同步的原理 （88）
4.1.1　载波同步的概念及实现方法 （88）
4.1.2　锁相环的工作方式 （89）
4.2　锁相环的数字化模型 （90）
4.2.1　数字鉴相器 （90）
4.2.2　数字环路滤波器 （91）
4.2.3　数字控制振荡器 （92）
4.2.4　数字锁相环动态方程 （93）
4.3　输入信号建模与仿真 （94）
4.3.1　工程实例需求 （94）
4.3.2　输入信号模型 （95）
4.3.3　输入信号的MATLAB仿真 （96）
4.4　载波同步环的参数设计 （99）
4.4.1　总体性能参数设计 （100）
4.4.2　数字鉴相器设计 （101）
4.4.3　环路滤波器及数控振荡器设计 （104）
4.5　载波同步环的FPGA实现 （106）
4.5.1　顶层模块的Verilog HDL实现 （106）
4.5.2　IIR滤波器的Verilog HDL实现 （108）

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